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2025/05/20 1

SPI Slave Interfac 설계, MicroBlaze

si_data : Reg_FSM 이 받을 datasi_done : Slave Intf가 데이터 다 보냈다고 보내는 신호 (si_done을 받고 Reg_FSM에 저장되어야 함) so_data : Reg_FSM 이 내보내는 dataso_start : Reg_FSM 이 data를 내보내겠다는 신호so_done : Slave Intf가 "처리를 다 했다" 라고 보내는 신호 Reg_FSM에도 SS underbar가 필요아이디어rising edge일 때 한 tick 발생하고, falling edge일 때 한 tick 발생하는 것을 button debounce의 edge detector를 활용해 설계 sync0_q : sysclk들어오면 sysclk rising edge일 때 SCLK가..

컴퓨터구조 2025.05.20
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ptat, half adder, ctat, clk divider, small signal model, amba apb, nmos, full adder, Verilog, 메모리 매핑, bandgap reference, pmos, 전자회로, 4 bit full adder, 컴퓨터 구조, 아날로그집적회로, MOSFET, 반도체, small signal analysis, BGR,

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